摘要：本發(fā)明公開了一種降低電源關(guān)斷時負載功耗的電路。該電路的電壓源連接至第一PMOS晶體管的源極和第二PMOS晶體管的源極，并通過第一電阻連接至第一PMOS晶體管的柵極和第二NMOS晶體管的漏極；第一PMOS晶體管的漏極和第二PMOS晶體管的柵極連接至第一控制信號輸出端；第三PMOS晶體管的柵極和第二NMOS晶體管的源極連接至第二控制信號輸出端；第一NMOS晶體管的漏極連接至第三PMOS晶體管的漏極、第一NMOS晶體管的柵極和第二NMOS晶體管的柵極，源極通過第二電阻接地。本發(fā)明的有益效果是：降低電源關(guān)斷時的負載功耗，減小關(guān)斷時的電流，減小大電流對元器件壽命的影響。
- 專利類型發(fā)明專利
- 申請人鄭州單點科技軟件有限公司;
- 發(fā)明人王紀云;吳勇;王曉娟;
- 地址450016 河南省鄭州市經(jīng)濟技術(shù)開發(fā)區(qū)第八大街信息產(chǎn)業(yè)園1228室
- 申請?zhí)?/b>CN201210360477.1
- 申請時間2012年09月26日
- 申請公布號CN103684377A
- 申請公布時間2014年03月26日
- 分類號H03K17/687(2006.01)I;
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